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    2025-05-20 10:09

  • 选择承包方

    2025-05-20 10:09

  • 项目工作中

  • 项目完成

  • 发布时间: 2025-05-20 10:09
  • 截止时间: 2025-06-19 10:09
  • 项目周期:详谈
  • 已有竞标: 2
  • 项目标签: 通讯 FPGA/CPLD 测试测量 工业控制 PCB
  • 项目预算:¥110000

    当前预算:¥10000-¥50000

    潜在追加预算:¥10000-¥50000

    远期可能追加投入:小于¥10000

  • 现居地址:广东省 深圳市 宝安区

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项目内容描述

    该项目涉及到标准PXIe高速串行总线背板设计,总共可用功能板卡槽位7槽,不需要设计系统槽位,系统槽位直接设计在背板上,远程通过光纤或者电缆与PC机主板PCIe槽位相连接,可接受使
人气:71

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发包方
  • Tacking    

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    发包数量: 4
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